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【简答题】

下列不属于组合逻辑电路的加法器为(). (A)半加器 (B)全加器 (C)多位加法器 (D)计数器 A.B.C.D. D

题目标签：逻辑电路加法器组合逻辑电路
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参考答案：
参考解析：
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举一反三

【判断题】并行加法器采用并行进位的目的是简化电路结构。( )
A.
正确
B.
错误
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【判断题】所有触发器都是时序逻辑电路。
A.
正确
B.
错误
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【判断题】时序逻辑电路的特点是：电路任一时刻的输出状态与同一时刻的输入信号有关，与原有状态没有任何的联系。
A.
正确
B.
错误
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【简答题】第二次实验报告:加法器设计
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【单选题】组合逻辑电路的输出取决于（）
A.
输入信号的现态
B.
输出信号的现态
C.
输出信号的次态
D.
输入信号的现态和输出信号的现态
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【单选题】组合逻辑电路的输出取决于（ ）。
A.
其它选项都不对
B.
输入信号的现态
C.
输入信号的现态和输出信号变化前的现态
D.
输出信号的现态
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【单选题】组合逻辑电路中的冒险是由于 引起的。
A.
电路未达到最简
B.
电路有多个输出
C.
电路中的时延
D.
逻辑门类型不同
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【简答题】加法器是算术运算电路中的基本运算单元,分为(3个字)和(3个字)两种
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【单选题】不属于CMOS逻辑电路优点的提法是（）。
A.
输出高低电平理想
B.
电源适用范围宽
C.
抗干扰能力强
D.
电流驱动能力强
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【简答题】用两个4位二进制加法器及适当的门电路构成1位余3码加法器。
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